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Data Sheet
SERIAL PRESENCE-DETECT MATRIX
Rev.1.3
09.11.2010
BYTE
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6
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8
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30
31
DESCRIPTION
NUMBER OF SPD BYTES USED
TOTAL NUMBER OF BYTES IN SPD DEVICE
FUNDAMENTAL MEMORY TYPE
NUMBER OF ROW ADDRESSES ON ASSEMBLY
NUMBER OF COLUMN ADDRESSES ON
ASSEMBLY
DIMM HIGHT AND MODULE RANKS
MODULE DATA WIDTH
MODULE DATA WIDTH (continued)
MODULE VOLTAGE INTERFACE LEVELS (V DDQ )
SDRAM CYCLE TIME, (t CK ) [max CL]
CL = 6 (6400), CL = 5 (5300), CL = 4 (4200)
SDRAM ACCESS FROM CLOCK, (t AC ) [max CL]
CL = 6 (6400), CL = 5 (5300), CL = 4 (4200)
MODULE CONFIGURATION TYPE
REFRESH RATE / TYPE
SDRAM DEVICE WIDTH (PRIMARY SDRAM)
ERROR- CHECKING SDRAM DATA WIDTH
MINIMUM CLOCK DELAY, BACK-TO-BACK
RANDOM COLUMN ACCESS
BURST LENGTHS SUPPORTED
NUMBER OF BANKS ON SDRAM DEVICE
CAS LATENCIES SUPPORTED
MODULE THICKNESS
DDR2 DIMM TYPE
SDRAM MODULE ATTRIBUTES
SDRAM DEVICE ATTRIBUTES: Weak Driver and
50 ODT
SDRAM CYCLE TIME, (t CK ) [max CL – 1]
CL = 5 (6400), CL = 4 (5300), CL = 3 (4200)
SDRAM ACCESS FROM CK, (t AC ) [max CL – 1]
CL = 5 (6400), CL = 4 (5300), CL = 3 (4200)
SDRAM CYCLE TIME, (t CK ) [max CL – 2]
CL = 2 (6400), CL = 3 (5300)
SDRAM ACCESS FROM CK, (t AC ) [max CL – 2]
CAS LATENCY = 3 (5300)
MINIMUM ROW PRECHARGE TIME, (t RP )
MINIMUM ROW ACTIVE TO ROW ACTIVE, (t RRD )
MINIMUM RAS# TO CAS# DELAY, (t RCD )
MINIMUM RAS# PULSE WIDTH, (t RAS )
MODULE BANK DENSITY
6400-666
0x25
0x40
0x70
0x30
0x45
0x3D
0x50
5300-555
0x80
0x08
0x08
0x0E
0x0A
0x61
0x40
0x00
0x05
0x30
0x45
0x00
0x82
0x08
0x00
0x00
0x0C
0x08
0x01
0x04
0x00
0x07
0x3C
0x1E
0x3C
0x2D
0x01
0x38
0x3D
0x50
0x50
0x60
4200-444
0x3D
0x50
Swissbit AG
Industriestrasse 4
CH-9552 Bronschhofen
Fon: +41 (0) 71 913 03 03
Fax: +41 (0) 71 913 03 15
www.swissbit.com
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